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  90nmディジタルCMOSプロセスハイゲイン-オフセットキャンセル-正帰還増幅器を利用した30mW12ピット50MS/sサブレンジング方式ADC(VLSI一般(ISSCC2006特集))

概要90nmディジタルCMOSプロセスにおいて12ビット50MS/sサブレンジング方式ADCを開発した。コースADCにはハイゲイン-オフセットキャンセル-正帰還増幅......
著者 清水 泰秀  村山 茂満  工藤 孝平  矢津田 宏智 
掲載論文集電子情報通信学会技術研究報告. ICD, 集積回路 106(71), 61-64, 2006-05-18
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  C-12-67 参照電位プリチャージ方式を用いた770MS/s, 8bitサブレンジング型ADC(C-12.集積回路,一般セッション)

著者 内野 浩基  清水 佑一郎  大山 康祐  山下 喜市 
掲載論文集電子情報通信学会総合大会講演論文集 2009年_エレクトロニクス(2), 155, 2009-03-04
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